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3.2 Circuits logiques de base 3.2.1 Circuits intégrés logiques (1/2)

3.2 Circuits logiques de base 3.2.1 Circuits intégrés logiques (1/2). Aussi appelé puce ou chip ou IC (Integrated Circuit) Généralement formé d’une petite plaquette de silicium (1*1 cm) Exemple d’un circuit intégré avec 4 portes et 14 broches. 3.2.1 Circuits intégrés (2/2).

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3.2 Circuits logiques de base 3.2.1 Circuits intégrés logiques (1/2)

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  1. 3.2 Circuits logiques de base3.2.1 Circuits intégrés logiques (1/2) • Aussi appelé puce ou chip ou IC (Integrated Circuit) • Généralement formé d’une petite plaquette de silicium (1*1 cm) • Exemple d’un circuit intégré avec 4 portes et 14 broches

  2. 3.2.1 Circuits intégrés (2/2) • 4 classes de circuits intégrés (selon le nombre de portes) • SSI (Small Scale Integrated): 1 à 10 portes • MSI (Medium Scale Integrated): 10 à 100 portes • LSI (Large Scale Integrated): 100 à 100’000 portes • VLSI (Very Large Scale Integrated): > 100’000 portes • Broches • Chaque broche correspond à une entrée ou sortie d’une porte (circuit élémentaire) ou à l’apport d’électricité ou à une connexion à la terre • Nombre usuel de broches: • 14, 16, 18, 20, 22, 24, 28, 40, 64, 68 (et bientôt 128, …) • Les broches se trouvent sur les 2 ou 4 côtés du circuit intégré (ou sur la surface du fond)

  3. 3.2.3 Circuits arithmétiques (1/5) • Décaleur (shifter) • Décalage d’un bit à droite (c=1) ou à gauche (c=0)

  4. 3.2.3 Circuits arithmétiques (2/5) • Additionneur 1-bit : le demi additionneur • Seulement destiné pour une addition de 2 bits

  5. 3.2.3 Circuits arithmétiques (3/5) • Additionneur 1-bit : l’additionneur complet • Destiné pour une suite d’additionneurs 1-bit

  6. 3.2.3 Circuits arithmétiques (4/5) • Unité arithmétique et logique - UAL (Arithmetic Logic Unit - ALU) (ENA=1, ENB=1, INVA=0) ENx : Enable x INVx : Invert x

  7. 3.2.3 Circuits arithmétiques (5/5) • Une ALU à 8 bits • Construit avec 8 «1-bit ALU»(aussi appelé un microprocesseur en tranche (bit slice processor))

  8. • A • B C 3.2.4 Horloges (Clocks) 4 instants de synchronisation(Fig. a-b) Front montant C1 Front montant C2 Front descendant C1 Front descendant C2 Horloge asymétrique (Fig. c)

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