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13 장 CTC and DMA. 학습개요. 이번 시간에는 ... “ CTC 와 DMA 에 대해 알아보겠습니다. 학 습 목 표. 이장에서는 주변장치 중에서 CTC 와 DMA 의 동작과정에 대하여 공부한다. 학 습 목 차. CTC DMA. 1/13. CTC. CTC ( Counter Timer circuit) 개요. CTC(Counter Timer Circuit) 일정한 Pulse 주기를 만들 때 일정한 시간 간격으로 Interrupt 발생 기능 외부신호의 입력 Pulse 계수 기능.

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Presentation Transcript
slide1

13장

CTC and DMA

Slide 1 (of 10)

slide2

학습개요

이번 시간에는...

“CTC와 DMA에 대해 알아보겠습니다.

학 습 목 표

이장에서는 주변장치 중에서 CTC와 DMA의 동작과정에 대하여 공부한다.

학 습 목 차

  • CTC
  • DMA

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1/13

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CTC

  • CTC (Counter Timer circuit) 개요
  • CTC(Counter Timer Circuit)
  • 일정한 Pulse 주기를 만들 때
  • 일정한 시간 간격으로 Interrupt 발생 기능
  • 외부신호의 입력 Pulse 계수 기능
  • 8253 (Programmable interval timer) CTC

(1) 8253Programmable Interval Timer.

1)특징

- +5V 단일 전원 사용.

-3개의 독립 채널.

-각 채널은 16비트 다운 카운터를 내장.

-각 카운터 입력최고 주파수=2.6MHz.

-6가지 동작 모드(모드0~모드5).

Slide 3 (of 10)

slide4

CTC

  • 8253 (Programmable interval timer) CTC

2) 8253 핀 기능

  • D0~D7 : 데이터 버스.
  • CS : 칩 선택.
  • A0~A1 : 어드레스 라인.
  • RD : Read.
  • WR : Write.
  • OUT 0~2 :
  • -클럭 출력.
  • -각 채널의 16비트 다운카운터의 출력.
  • CLK0~2 :
  • -클럭 입력.
  • -각 채널의 16비트 다운카운터의 클럭 입력.
  • -하강 에지 동작.
  • -2.6MHz 이하 주파수만 사용.
  • -GATE0~2 : 게이트 입력.

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slide5

CTC

  • 8253 (Programmable interval timer) CTC

3) 8253 CTC 구조

DATA BUS

CLK 0

GATE0

OUT0

COUNTER 0(00)

DATA

BUS

BUFFER

CLK 1

GATE1

OUT1

COUNTER 1(01)

Read

Write

Logic

/RD

/WR

A0

A1

/CS

CLK 2

GATE2

OUT2

COUNTER 2(10)

CONTROL

WORD

REGISTER

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slide6

DMA (Direct Memory Access)

  • DMA (Direct Memory Access) 개요

대량 단순 Data 전송 시 CPU를 거치지 않고 직접 전송하는 방식

1) 일반적인 Data 전송 2) DMA를 이용한 전송

high impedance

CPU

MEMORY

CPU

MEMORY

Data

제어신호

DMA

controller

I/O device

high impedance

I/O device

◈ Cycle Stealing

제어신호

Slide 6 (of 10)

slide7

DMA (Direct Memory Access)

  • DMA (Direct Memory Access) 개요

3) DMA controller

Address Register

Address Bus

DMA request

Data Counter Register

Data Bus

DMA acknowledge

Control Register

Memory control

Bus control Logic

Address Register : 현재 access할 번지 지정하는 register

Data Counter Register : 전송할 Data 갯 수를 내장

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slide8

DMA (Direct Memory Access)

  • DMA (Direct Memory Access) 개요

4) DMA 처리 예

(a) CPU에서 memory시작주소와

Data 갯 수 전송

Bus System

Bus System

CPU

Memory

CPU

Memory

Address

Address

Data

Data

DMA

controller

Control

1

DMA

Controller

BUSRQ

BUSRQ

Control

4000

100

2

(b) DMA에서 CPU로 BUS 사용권 요구

Slide 8 (of 10)

slide9

DMA (Direct Memory Access)

  • DMA (Direct Memory Access) 개요

4) DMA 처리 예

high impedance

high impedance

CPU

Memory

Address

3

CPU

Memory

Data

Address

DMA

Controller

Data

BUSRQ

Control

DMA

Controller

4000

BUACK

Control

Data 전송

100

4000

5

100

4

I/O

device

(d) DMA의 시작번지부터 1씩

Data 전송

(c) CPU에서 BUSACK 신호 전송

Slide 9 (of 10)

slide10

DMA (Direct Memory Access)

  • DMA (Direct Memory Access) 개요

4) DMA 처리 예

Bus System

CPU

Memory

Address

Data

6

DMA

Controller

BUSRQ

(e) CPU의 address, data bus 가 정상상태로 복구한다

Control

4000

Data 전송

100

I/O

device

DMA 실행 중

BUSRQ’

(f) DMA 실행 끝

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